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A flow is presented for the automatic layout synthesis of analog circuits based on a schematic and a set of design parameters. The new flow is driven by design, placement, and routing constraints only, such that no predefined layout template is necessary. The flow is integrated with a deterministic nonlinear optimization algorithm to perform layout-driven circuit sizing. This procedure was applied to several CMOS circuits, including a large analog block with 52 transistors. A significant improvement in the satisfaction of electrical performance objectives was shown in the comparison to traditional circuit sizing without layout synthesis integration. Vorgestellt wird ein Verfahren zur automatischen Synthese analoger Schaltungen ausgehend von einer Netzliste und einer Menge von Entwurfsparametern. Die neue Methode basiert ausschließlich auf Entwurfs-, Platzierungs- und Verdrahtungsbedingungen, und benötigt, im Gegensatz zu existierenden Verfahren, keine Layout-Vorlagen. Die Synthese ist Teil einer nichtlinearen, Layout-orientierten Optimierung zur Schaltungsdimensionierung. Das Verfahren wurde zur Layout-orientierten Dimensionierung von mehreren CMOS-Schaltungen, darunter ein großes Analog-Subsystem mit 52 Transistoren, angewandt. Im Vergleich zu Verfahren, die Platzierung und Verdrahtung nicht berücksichtigen, konnten deutliche Verbesserungen hinsichtlich der Erfüllung der Optimierungsziele erreicht werden. |
