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Autor:
Nieto Ramirez, Nathaly1 nathaly.nieto@correounivalle.edu.co, Nieto Londoño, Rubén Darío1 ruben.nieto@correounivalle.edu.co
Publikováno v:
INGENIARE - Revista Chilena de Ingeniería. mar2019, Vol. 27 Issue 1, p43-51. 9p.
Publikováno v:
Journal of Research of the University of Quindio / Revista de Investigaciones Universidad del Quindio. 2014, Vol. 25 Issue 1, p134-140. 7p. 3 Charts.
Autor:
Bolaños Martínez, Freddy1 fremar@yubarta.univalle.edu.co, Nieto Londoño, Rubén Darío2 rnieto@univalle.edu.co, Bernal Noreña, Álvaro3 alvaro@univalle.edu.co
Publikováno v:
Ingeniería y Competitividad. Dec2004, Vol. 6 Issue 2, p25-34. 10p.
Publikováno v:
Iteckne, Volume: 11, Issue: 2, Pages: 149-156, Published: DEC 2014
En este artículo se presenta la descripción y los resultados de la implementación en hardware del algoritmo criptográfico Threefish en su proceso de cifrado. La implementación se realizó usando la arquitectura de ronda iterativa sobre la Field
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https://explore.openaire.eu/search/publication?articleId=od_______618::937792fe25995c3987653f0873aed01d
http://www.scielo.org.co/scielo.php?script=sci_arttext&pid=S1692-17982014000200005&lng=en&tlng=en
http://www.scielo.org.co/scielo.php?script=sci_arttext&pid=S1692-17982014000200005&lng=en&tlng=en
Publikováno v:
RED: Repositorio Educativo Digital UAO
Universidad Autónoma de Occidente
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Universidad Autónoma de Occidente
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En el presente artículo se presenta el diseño de tres estrategias de control y se incluye un análisis comparativo de sus desempeños en la compensación de una planta que presenta ciclo de histéresis, tiempo de retardo y altas variaciones en sus
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https://explore.openaire.eu/search/publication?articleId=dedup_wf_001::ffb11c1a24efa4d92d0f9885dedcfbcd
Publikováno v:
Repositorio Digital Univalle
Universidad del Valle
instacron:Universidad del Valle
Universidad del Valle
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Se mencionan las características básicas de un Analizador Lógico. Se utiliza la tecnología de circuitos integrados, con matrices lógicas reprogramables por el usuario (FPGA's: Field Programable Gate Arrays) y se indica como diseñar y construir
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https://explore.openaire.eu/search/publication?articleId=od______3056::1f0e9cefe8f2758f83f3f5f452aad3a5
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Repositorio Digital Univalle
Universidad del Valle
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Universidad del Valle
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Este artículo describe la estrategia de diseño e implementación para un sistema universal de desarrollo con microprocesador. La tarjeta digital se compone de un conjunto de puertos sencillos, memoria RAM, memoria ROM y una base universal para cual
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https://explore.openaire.eu/search/publication?articleId=od______3056::2f9a05f7e3542facb7f13953d07752f5
Publikováno v:
Repositorio Digital Univalle
Universidad del Valle
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Universidad del Valle
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En este trabajo se presenta el diseño en hardware reconfigurable de los sub-bloques que constituyen un sistema RSA de criptografía. Se presentan las diferentes arquitecturas que reproducen los algoritmos seleccionados y los resultados de simulació
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https://explore.openaire.eu/search/publication?articleId=od______3056::f1f99a3763df0eee27503b4442f5aa31
Autor:
Duque Peréz, Eugenio Antonio, Aedo Cobo, José Edinson, Correa, Julián, Ramírez Orozco, Alexis Alberto, Torres, Camilo, Nieto Londoño, Rubén Darío, Bernal Noreña, Álvaro
Publikováno v:
Repositorio UdeA
Universidad de Antioquia
instacron:Universidad de Antioquia
Universidad de Antioquia
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RESUMEN: En este artículo se describe la concepción, diseño, simulación e implementación de un analizador lógico de tiempos implementado sobre una arquitectura digital reprogramable. El sistema fue especificado en VHDL [1] e implementado en una
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https://explore.openaire.eu/search/publication?articleId=od______3056::e1d8eb7957a07d71b0301316dc61e482
https://revistas.udea.edu.co/index.php/ingenieria/article/view/343172
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Akademický článek
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