Plateforme multi-ASIP reconfigurable dynamiquement pour le turbo décodage dans un contexte multi-standard

Autor: Vianney Lapotre, Murugappa Velayuthan, Purushotham, Gogniat, Guy, Baghdadi, Amer, Diguet, Jean-Philippe

Publikováno v: GRETSI 2013 : 24ème colloque du Groupement de Recherche en Traitement du Signal et des Images
GRETSI 2013 : 24ème colloque du Groupement de Recherche en Traitement du Signal et des Images, Sep 2013, Brest, France. 2013
GRETSI 2013 : 24ème colloque du Groupement de Recherche en Traitement du Signal et des Images, Sep 2013, Brest, France
HAL
BASE-Bielefeld Academic Search Engine

National audience; La multiplication des standards de communication sans fils introduit le besoin de récepteurs multi-standards reconfigurables. Afin d'adresser cette problématique et faire face à la demande croissante en débit des applications s

Externí odkaz: https://explore.openaire.eu/search/publication?articleId=dedup_wf_001::b877b71bd9ddf7d0d533c9fb24751e4b
https://hal.archives-ouvertes.fr/hal-00876009

Efficient dynamic configuration of a multi-ASIP turbo decoder

Autor: Lapotre, Vianney, Murugappa Velayuthan, Purushotham, Gogniat, Guy, Baghdadi, Amer, Bazin, Jean-Noël, Diguet, Jean-Philippe, Hubner, Michael

Publikováno v: GDR SoC-SiP 2013 : Colloque National du Groupe de Recherche System on Chip-System in Package
GDR SoC-SiP 2013 : Colloque National du Groupe de Recherche System on Chip-System in Package, Jun 2013, Lyon, France

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https://hal.archives-ouvertes.fr/hal-00876017/document

Flexible Multi-ASIP SoC for Turbo/LDPC Decoder

Autor: MURUGAPPA VELAYUTHAN , Purushotham, Reddy , Pallavi, AL KHAYAT , Rachid, BAZIN , Jean-Noël, BAGHDADI , Amer, Clermidy , Fabien, Jezequel , Michel

Publikováno v: SOC-SIP : colloque national du groupe de recherches System On Chip-System In Package
SOC-SIP : colloque national du groupe de recherches System On Chip-System In Package, Jun 2012, Paris, France. 2012
SOC-SIP : colloque national du groupe de recherches System On Chip-System In Package, Jun 2012, Paris, France

International audience; In order to meet flexibility and performance constraints of current and future digital communication applications, multiple ASIPs combined with dedicated communication and memory architectures are required. In this work we con

Externí odkaz: https://explore.openaire.eu/search/publication?articleId=dedup_wf_001::333a0d051986ef7459cff0d01f4e2001
https://hal.archives-ouvertes.fr/hal-00725184/file/47_GDR_SOC_SIP_Flexible_Multi-ASIP_SoC_for_Turbo_LDPC_Decoder.pdf