Výsledky vyhledávání - "HERING, KLAUS"

Kniha

Zwischenbericht zur Arbeit im DFG-Projekt 'Partitionierungsalgorithmen für Modelldatenstrukturen zur parallelen compilergesteuerten Logiksimulation

Autor: Spruth, Wilhelm G., Hering, Klaus, Haupt, Reiner, Petri, U.

Publikováno v: Report / Institut für Informatik.

Unser Forschungsvorhaben hat die Entwicklung, Analyse und Implementierung von Partitionierungsalgorithmen für industrierelevante Modelle kompletter Prozessorstrukturen mit mehreren Millionen Elementen auf der Gate-Ebene in Vorbereitung der parallele

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Conference

Parallel Evolutionary Algorithms with SOM-Like Migration and their Application to Real World Data Sets

Autor: Villmann, Thomas, Haupt, Reiner, Hering, Klaus, Schulze, Hendrik

We introduce a multiple subpopulation approach for parallel evolutionary algorithms the migration scheme of which follows a SOM-like dynamics. We succesfully apply this approach to clustering in both VLSI-design and psychotherapy research. The advant

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Conference

Cycle-based simulation on loosely-coupled systems

Autor: Döhler, Denis, Hering, Klaus, Spruth, Wilhelm G.

Logic simulation is a crucial verification task in processor design. Aiming at significant acceleration of system simulation we have parallelized IBM's cycle-based simulator TEXSIM. The resulting parallelTEXSIM has already been employed successfully

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Conference

Integration of a Local Search Operator into Evolutionary Algorithms for VLSI-Model Partitioning

Autor: Haupt, Reiner, Hering, Klaus, Siedschlag, Thomas

The application of Evolutionary Algorithms in hierarchical model partitioning for parallel system simulation in VLSI design processes has proven to be successful. Thereby, individuals embody partitions of hardware designs. On the basis of a formal mo

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Kniha

Zwischenbericht zur Arbeit im DFG-Projekt 'Modellpartitionierung, Logiksimulation

Autor: Spruth, Wilhelm G., Hering, Klaus, Haupt, Reiner, Petri, Udo

Publikováno v: Report / Institut für Informatik.

Der Entwurf komplexer VLSI-Strukturen erfordert eine durchgängige Begleitung durch Verifikationsprozesse. eine Hauptform der Entwurfsverifikation ist die Simulation. Im Rahmen der Systemsimulation kompletter Prozessorstrukturen auf Register-Transfer

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Conference

Parameterized Partition Valuation for Parallel Logic Simulation

Autor: Hering, Klaus, Haupt, Reiner, Petri, Udo

Parallelization of logic simulation on register-transfer and gate level is a promising way to accelerate extremely time-extensive system simulation processes during the design of whole processor structures. The background of this paper is given by th

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Kniha

Parallel Cycle Simulation

Autor: Hering, Klaus

Publikováno v: Report / Institut für Informatik.

Parallelization of logic simulation on register-transfer and gate level is a promising way to accelerate extremely time extensive system simulation processes for whole processor structures. In this report parallel simulation realized by means of the

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Kniha

Cone-basierte, hierarchische Modellpartitionierung zur parallelen compilergesteuerten Logiksimulation beim VLSI-Design

Autor: Hering, Klaus, Haupt, Reiner, Villmann, Thomas

Publikováno v: Report / Institut für Informatik.

Eine wichtige Form der Verifkation von komplette Prozessorstrukturen umfassenden VLSI-Entwürfen stellt die funktionelle Logiksimulation auf Gatter- und Register-Ebene dar. Im Kontext der Entwicklung eines parallelen Logiksimulationssystems auf Basis

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An Improved Mixture of Experts Approach for Model Partitioning in VLSI-Design Using Genetic Algorithms

Autor: Hering, Klaus, Haupt, Reiner, Villmann, Thomas

Publikováno v: Report / Institut für Informatik.

The partitioning of complex processor models on the gate and register-transfer level for parallel functional simulation based on the clock-cycle algorithm is considered. We introduce a hierarchical partitioning scheme combining various partitioning a

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Partitionierungsalgorithmen für Modelldatenstrukturen zur parallelen compilergesteuerten Logiksimulation (Projekt)

Autor: Hering, Klaus

Publikováno v: Report / Institut für Informatik.

Die enorme Komplexität in naher Zukunft absehbarer VLSI-Schaltkreisentwicklungen bedingt auf allen Entwurfsebenen sehr zeitintensive Simulationsprozesse. Eine Antwort auf diese Herausforderung besteht in der Parallelisierung dieser Prozesse. Es wird

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