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Caracterización de Cargas para Redes de Computación Exascale
Autor: Duro-Gómez, José, Petit Martí, Salvador Vicente, Sahuquillo Borrás, Julio, Gómez Requena, María Engracia
Publikováno v: RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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[ES] La computación exascale es el siguiente paso en la computación de alto rendimiento proporcionada por sistemas compuestos por millones de núcleos de procesamiento interconectados. Para guiar el diseño e implementación de dichos sistemas, se
Externí odkaz: https://explore.openaire.eu/search/publication?articleId=dedup_wf_001::f193ddd48bd637a8bb9941a2f8999ad1
http://hdl.handle.net/10251/112205
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Modelado de una Red Fotónica para Computación Exascale
Autor: Duro Gómez, José, Petit Martí, Salvador Vicente, Sahuquillo Borrás, Julio, Gómez Requena, María Engracia
Publikováno v: RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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La mayoría de las investigaciones actuales se realizan en simuladores desarrollados para redes eléctricas, cuyos componentes difieren mucho de los componentes fotónicos. Además, la tecnología fotónica añade nuevos componentes que no están pre
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https://hdl.handle.net/10251/88588
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A Fault-Tolerant Routing Strategy for K-ary N-direct S-indirect Topologies Based on Intermediate Nodes
Autor: Peñaranda Cebrián, Roberto, Gómez Requena, María Engracia, López Rodríguez, Pedro Juan, Gran, Ernst Gunnar, Skeie, Tor
Publikováno v: RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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[EN] Exascale computing systems are being built with thousands of nodes. The high number of components of these systems significantly increases the probability of failure. A key component for them is the interconnection network. If failures occur in
Externí odkaz: https://explore.openaire.eu/search/publication?articleId=dedup_wf_001::1b75f94ee47dcc54ffd58969ada41cbd
http://hdl.handle.net/10852/65180
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Bringing Real Processorsto Labs
Autor: Gómez Requena, Crispín, Gómez Requena, María Engracia, Sahuquillo Borrás, Julio
Publikováno v: RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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The architecture of current processors has experienced great changes in the last years, leading to sophisticated multithreaded multicore processors. The inherent complexity of such processors makes difficult to update processor teaching to include cu
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https://hdl.handle.net/10251/75304
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OMHI 2012: First international workshop on on-chip memory hierarchies and interconnects: organization, management and implementation
Autor: Sahuquillo Borrás, Julio, Gómez Requena, María Engracia, Petit Martí, Salvador Vicente
Publikováno v: RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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Lecture Notes in Computer Science ISBN: 9783642369483
Euro-Par Workshops
Current CMPs include high amounts of on-chip memory storage, organized either as caches or main memory to avoid the huge latencies of accessing offchip DRAM memory. To address internal data access latencies, a fast on-chip network interconnects the m
Externí odkaz: https://explore.openaire.eu/search/publication?articleId=doi_dedup___::85cc027f5aea4864463cd6312a931faf
http://hdl.handle.net/10251/39684
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Akademický článek
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Una Nueva Familia de Topologías Indirectas, Eficientes y Tolerantes a Fallos
Autor: Diego Fernando, Bermúdez Garzón
Publikováno v: RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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[EN] Large parallel computers are currently adopting the cluster architecture as the basis for their construction. These machines are being built with thousands of processing nodes that are interconnected through high-speed interconnection networks.P
Externí odkaz: https://explore.openaire.eu/search/publication?articleId=doi_dedup___::09cf938b8b3bc6a9e5bc22a74c2284e9
http://hdl.handle.net/10251/59386
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Design Space Exploration for Networks On-chip
Autor: Francisco Gilabert Villamón
Publikováno v: Riunet
RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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Los diseños multi-núcleo se están convirtiendo en la solución más popular a la mayoría de las limitaciones de los diseños mono-núcleo. Un diseño multi-núcleo sigue el paradigma de diseño conocido como Sistema dentro del Chip (o SoC , del i
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https://doi.org/10.4995/thesis/10251/11521
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Low-Memory Techniques for Routing and Fault-Tolerance on the Fat-Tree Topology
Autor: Crispín Gómez Requena
Publikováno v: RiuNet. Repositorio Institucional de la Universitat Politécnica de Valéncia
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Riunet
Actualmente, los clústeres de PCs están considerados como una alternativa eficiente a la hora de construir supercomputadores en los que miles de nodos de computación se conectan mediante una red de interconexión. La red de interconexión tiene qu
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https://doi.org/10.4995/thesis/10251/8856
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